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2024.10.27 01:42

ブロックデザインはシミュレーションできない?


・ブロックデザインのトラブルは続くのだった。とにかく色々やってみる・・・・・・が全部Vivadoが落ちて終わってしまう。
・いろいろやっているうちに突然うまくいったように見えることがあるのだけど、これは記述のミスで信号が全く動いていない時。
・ちゃんと動くようにソースを変更すると、見事に落ちる。つまり、シミュレーションしているときに信号に変化があると落ちてしまうという謎現象。原因不明。どうにもならんな。
・それならばと、論理合成後のシミュレーションを試してみる。これもうまく行ったかなと思えたのは記述ミスがあったときだけでちゃんと修正すると落ちてしまう。
・ちなみに、このソースをちょっといじってIcarus Verilogにかけると何も問題なく動作波形が得られた。うん、この波形は予定どおりだ。